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應用材料芯片布線技術取得突破 邏輯微縮可進入3nm及以下技術節(jié)點

日期:2021-06-18 來源:全球半導體觀察閱讀:310
核心提示:日前,應用材料公司宣布推出一種全新的先進邏輯芯片布線工藝技術,可微縮到3納米及以下技術節(jié)點。
日前,應用材料公司宣布推出一種全新的先進邏輯芯片布線工藝技術,可微縮到3納米及以下技術節(jié)點。
 
據應用材料介紹,其開發(fā)了一種名為Endura? Copper Barrier Seed IMS?的全新材料工程解決方案。這個整合材料解決方案在高真空條件下將ALD、PVD、CVD、銅回流、表面處理、界面工程和計量這七種不同的工藝技術集成到一個系統(tǒng)中。
 
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圖片來源:應用材料
 
其中,ALD選擇性沉積取代了ALD共形沉積,省去了原先的通孔界面處高電阻阻擋層。解決方案中還采用了銅回流技術,可在窄間隙中實現(xiàn)無空洞的間隙填充。通過這一解決方案,通孔接觸界面的電阻降低了50%,芯片性能和功率得以改善,邏輯微縮也得以繼續(xù)至3納米及以下節(jié)點。
 
應用材料表示,這種獨特的整合解決方案旨在幫助客戶改善性能、功率和面積成本。Endura Copper Barrier Seed IMS系統(tǒng)現(xiàn)已被客戶運用在全球領先的邏輯節(jié)點代工廠生產中。
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